EV12DS460A K波段的數(shù)模轉(zhuǎn)換器Teledyne E2V
發(fā)布時間：2022-05-25 17:02:46 瀏覽：1783
EV12DS460A是TeledyneE2V的12位6.0GSps DAC，具備集成的4:1或2:1多路復用器和7.5GHz輸出帶寬，鑒于DSP時鐘、OCD、PSS、TVF等用戶友好功能，可輕易與規(guī)范FPGA進行接口。
EV12DS460A內(nèi)嵌了4種不同的輸出模式（NRZ、RTZ、NRTZ和RF），可按照所需的奈奎斯特范圍進行性能優(yōu)化。EV12DS460A創(chuàng)新性的DAC提供了超過7GHz的模擬帶寬，有利于實現(xiàn)高至K波段(26.5GHz)的多波段、直接數(shù)字合成。
EV12DS460提供高至6GSps的確保采樣率，并能夠以7GSps運轉(zhuǎn)。具備四種輸出操作模式（NRZ、RTZ、NRTZ和RF）。EV12DS460A還包括一個獨特的可編程脈沖整形功能，可用作跨多個奈奎斯特區(qū)作業(yè)。
主要特點
?12位分辨率
?6.0GSps確保轉(zhuǎn)換率
?7.0GSps操控
?‐3dB模擬輸出帶寬7.5GHz（DAC輸出階躍響應的30ps上升和下降時間）
?支持高至12GHz（X波段）的射頻信號合成
?支持高至24GHz的射頻信號合成（降低輸出功率）
?4:1或2:1集成串行MUX（可選）
?可選輸出模式：
ReturnToZero(RTZ),NonReturntoZero(NRZ),Narrow
ReturnToZero(NRTZ)andRadioFrequency(RF)
?低延遲時間：3個時鐘周期
?2.6瓦功能損耗（4:1MUX）
?3線串行接口
?作用：
–可選MUX比4:1（高至6.0GSps），2:1（高至3.2GSps）
–用戶友好的作用，通過3WSI串行接口進行數(shù)字控制：
?增益調(diào)節(jié)
?輸出時鐘分頻選擇（調(diào)整DSP時鐘分頻比的可能性）（OCDS）
?調(diào)節(jié)整形脈沖寬度（RPW）和整形脈沖開始（RPB）以優(yōu)化性能
?與DSP同步的時鐘相移選擇（PSS[2:0]）
?時鐘模式下輸入1/2/4（IUCM）
?直接訪問bitOCD和PSS
?與FPGA檢查（IDC）定時端口的輸入數(shù)據(jù)檢查位
?FPGA的時序沖突標志（設置或保持）
?通訊監(jiān)控（TVF）
?LVDS差分數(shù)據(jù)輸入和DSP時鐘輸出。
?模擬輸出差動擺幅：1Vpp（100W差動阻抗）
?可用作多個DAC同步的外部同步
?開關(guān)電源：3.3V（數(shù)字）、3.3V和5V（模擬）
?FpBGA封裝（15x15mm機身尺寸，1mm間距）
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